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下午好，对于像23K256或23LC1024这样的设备，执行以下步骤：-只发送读取地址（部分指令）；-发送要写入的地址+字节（完整指令）；我的问题是，如果我指向读取地址，要读取的数据是否已经加载到传输缓冲器还是只在实际读取与发送读指令时才会出现这种情况？最好的问候
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13个回答
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你说的“部分教学”是什么意思？查看23LC1024的数据表，您必须发送读命令、24位起始地址，然后返回每个值的虚拟值。一旦您提升了CSpin，事务就将结束，您必须重新开始。如果您正在讨论的是在CS行低位的SPI交换之间添加中断（即，发送部分命令，等待，然后在设备被选中时发送剩余的命令），那么您可以执行b但是，你必须小心SCK线路上的杂散信号，这样当主设备没有发送时钟脉冲时，从设备就不会认为它正在接收时钟脉冲。苏珊
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你为什么要问？这个问题与“ISR的猫死了还是活了？”也就是说，不可能知道RAM是否已经执行了内部读取，因为一旦你解除了CS的断言，你就不能读取它。如果它是你关心的一些模糊的副作用，那么就把它拼写出来。
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好的，关于我所知道的控制信号，最大的疑问是关于RAM数据总线的内部操作。我正在创建一个音频延迟线，我需要的是下面，指出一个地址，该地址的值在RAM的传输缓冲区中，当d进行写入，利用RAM的全双工特性，自动检索dsPIC DMA中RAM缓冲区中读取的值，该值最初已经加载。这种方式减少了操作的时间，并获得了RAM中的期望值。
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在数据表中，您看到了这种模式的描述吗？
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由于没有在数据表中找到，也不知道我在论坛上提出的建议是否可行，但我正在从其他来源进行研究，并且为了得到我在这里得到的答案，我相信这甚至不可能。
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我很困惑这意味着什么。你建议使用数据表中从未提到过的东西。这只是一厢情愿吗？
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不一定要利用数据表中没有的东西，但主要是更好地理解在HW级别的RAM总线数据移动，而不仅仅是FW，并探索减少RAM访问时间的可能性。
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浪费时间。如果它没有在数据表中指定，那么你不能依靠任何你发现继续工作的东西。
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这对我来说就像一个XY问题（http://xyproblem.info/），如果你告诉我们你试图解决的真正问题是什么，你认为这是解决问题的办法，可能会有所帮助。
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你看过数据表了吗？
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只需使用一些扬声器扬声器电缆就可以了。：）
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苏珊，你问我在做什么。利用RAM的全双工传输特性，我需要写一个地址和读另一个地址。正如他打算做的那样，指出读地址并假设这些数据将被放入传输缓冲区，将写命令发送到另一个地址将自动获得dsPIC DMA缓冲区中的数据。如果我只发送读取地址，数据会被加载到传输缓冲区吗？谢谢。
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你已经被问到你有什么证据证明这样的特征存在，而你却没有。如果您在读取序列之前中止了该序列，就没有文档化的方法。什么传输缓冲区？你打算如何从这个想象的缓冲区得到任何东西？
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