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请问我的ADC与DSP的EMIF接口设计还有问题吗？

2019-10-28 07:58:46 2753 adc 管脚 EMIF

0 最近在做一个数据采集电路，在设计电路的时候遇到了一些如下的问题： 1、16位的EMIF与12位带内部FIFO的ADC相连时，EMIF剩下的四个数据端口是直接接地吗？ 2、我所选的ADC有两个片选输入管脚，我把其中的一个直接接的高电平使其一直有效，这种接法可以吗？ADC的时序图在附件里面。 3、如果能有人帮我看一下ADC与DSP的EMIF接口设计有没有问题就好啦。我设计的ADC与EMIF的接口电路也在附件里面。非常期待社区的热心人给予解答，谢谢。 0
2019-10-28 07:58:46　　评论淘帖0 举报相关推荐 • 基于EMIF接口的DSP控制系统设计 5911 • 使用EMIF将Xilinx FPGA与TI DSP平台接口 71 • 基于EMIF接口的DSP+FPGA系统实现 5649 • EMIF接口的基本介绍 4492 • 请问我还有必要学习ucosII移植吗？ 1081 • 请问我这个PCB图还有什么毛病？ 625 • 请问我绘制的pcb还有什么问题？ 536 • 请问我画的这个PCB还有什么问题？ 795 • 请问我这个板子还有什么需要改进的？ 1462 • 请问我画的32系统还有什么问题吗？ 956 10 个讨论

0 顺便提一下，这个ADC看上去还是蛮高级的，为什么选择跟C5517用，而不选一款C6000的DSP，比如C6748。你准备用多高的采样率？有没有考虑过EMIF的速度是否够？ http://processors.wiki.ti.com/index.php/Main_Page Think Over Before Asking. http://www.catb.org/~esr/faqs/smart-questions.html#goal

2019-10-28 08:03:58 评论举报 1^# 李波

0 lifei639156 发表于 2019-10-28 12:09 <blockquote class="quote"/> <blockquote class="quote"/> <blockquote class="quote"/> 十分感谢！ 1、这个ADC我用到的时序是RD control,按照您的意思，这种接法应该是没问题的。 2、C67浮点系列的DSP我也有考虑过，但是我选用C5517的原因是：硬件FFT加速器；内部RAM较大；200MHz的时钟频率对于要做的信号处理也能达到处理时间上的要求，还有一点就是自己对于C55X DSP的软硬件设计相对于C6000更熟悉一点。 3、这个ADC（采样率6MSPS）的文档里面有其与C54X EMIF的连接方法，我觉得C5517作为C55X系列较高端的芯片它的EMIF的速度应该足够了。

2019-10-28 08:19:59 评论举报 2^# 阮盛婧

0 小鱼晨晨发表于 2019-10-28 12:25 十分感谢！ 1、这个ADC我用到的时序是RD control,按照您的意思，这种接法应该是没问题的。 2、C67浮点系列的DSP我也有考虑过，但是我选用C5517的原因是：硬件FFT加速器；内部RAM较大；200MHz的时钟频率对于要做的信号处理也能达到处理时间上的要求，还有一点就是自己对于C55X DSP的软硬件设计相对于C6000更熟悉一点。关于EMIF接口的速度，有条件的话，还是先测一下比较稳妥。接法没问题，访问流程就是DATA READY信号触发EDMA去读EMIF上ADC里的FIFO数据。 http://processors.wiki.ti.com/index.php/Main_Page Think Over Before Asking. http://www.catb.org/~esr/faqs/smart-questions.html#goal

2019-10-28 08:29:40 评论举报 3^# 李波

0 好的，谢谢。还有一个问题就是，我用McBSP的发送时钟引脚CLKX给ADC提供采样时钟，这种接法可以吗？

2019-10-28 08:49:21 评论举报 4^# 阮盛婧

0 小鱼晨晨发表于 2019-10-28 12:54 好的，谢谢。还有一个问题就是，我用McBSP的发送时钟引脚CLKX给ADC提供采样时钟，这种接法可以吗？我看手册，这个ADC对时钟没什么时序上的要求，只要有连续的时钟就可以。用mcbsp的发送时钟的话，那你要使能mcbsp，配置为内部时钟模式。你觉得CLKOUT管脚如何呢？ http://processors.wiki.ti.com/index.php/Main_Page Think Over Before Asking. http://www.catb.org/~esr/faqs/smart-questions.html#goal

2019-10-28 08:57:11 评论举报 5^# 李波

0 lifei639156 发表于 2019-10-28 13:02 我看手册，这个ADC对时钟没什么时序上的要求，只要有连续的时钟就可以。用mcbsp的发送时钟的话，那你要使能mcbsp，配置为内部时钟模式。你觉得CLKOUT管脚如何呢？ http://processors.wiki.ti.com/index.php/Main_Page C5517官方手册里面关于其CLKOUT引脚的说明如下：For debug purposes, the DSP includes a CLKOUT pin which can be used to tap different clocks within the clock generator. The SRC bits of the CLKOUT Configuration Register (CLKOUTCR) can be used to specify the source for the CLKOUT pin.CLKOUT reflects either the CPU clock, SAR, USB PHY, or PLL clock dependent on the setting of the CLOCKOUT Clock Source Register. 我想大致意思应该是：为了调试的目的，DSP包含了一个可以被用于分接时钟发生器内不同的时钟的CLKOUT引脚，CLKOUTCR寄存器的SRC位可以用来指定CLKOUT引脚的时钟源。CLKOUT引脚可以映射CPU时钟，SAR，USB PHY或PLL时钟。所以，CLKOUT引脚的目的我想应该是测试芯片内部各个时钟是否正确工作用的。设计中我也只是把这个引脚连了出来，没有使用。

2019-10-28 09:13:06 评论举报 6^# 阮盛婧

0 是的，这个时钟既可以用来观测内部各节点的时钟频率，也是可以用做其它目的的，反正是个输出信号，用了又不会影响芯片内部。 http://processors.wiki.ti.com/index.php/Main_Page Think Over Before Asking. http://www.catb.org/~esr/faqs/smart-questions.html#goal

2019-10-28 09:22:13 评论举报 7^# 李波

0 lifei639156 发表于 2019-10-28 13:27 是的，这个时钟既可以用来观测内部各节点的时钟频率，也是可以用做其它目的的，反正是个输出信号，用了又不会影响芯片内部。 http://processors.wiki.ti.com/index.php/Main_Page Think Over Before Asking. 那CLKOUT的输出频率的配置灵活吗？比如配置输出频率为6MHz，4MHz等。

2019-10-28 09:32:34 评论举报 8^# 阮盛婧

0 小鱼晨晨发表于 2019-10-28 13:37 那CLKOUT的输出频率的配置灵活吗？比如配置输出频率为6MHz，4MHz等。时钟源可以选择48MHz USB时钟，再从48MHz分频就可以得到。 http://processors.wiki.ti.com/index.php/Main_Page Think Over Before Asking. http://www.catb.org/~esr/faqs/smart-questions.html#goal

2019-10-28 09:51:01 评论举报 9^# 李波

0 懂了，谢谢。这一版我先用McBSP的输出时钟，后面测试一下CLKOUT的输出频率，如果可行，以后用CLKOUT。

2019-10-28 10:09:51 评论举报 10^# 阮盛婧

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