完善资料让更多小伙伴认识你,还能领取20积分哦, 立即完善>
大家好,
我对第34页的VC707用户指南中的“表1-11:FPGA U1的GTX接口连接”感到困惑。 其外观如下: MGT_BANK_118 GTXE2_CHANNEL_X1Y20 FMC1 HPC DP4GTXE2_CHANNEL_X1Y21 FMC1 HPC DP5GTXE2_CHANNEL_X1Y22 FMC1 HPC DP6GTXE2_CHANNEL_X1Y23 FMC1 HPC DP7 MGT_BANK_119 GTXE2_CHANNEL_X1Y24 FMC1 HPC DP0GTXE2_CHANNEL_X1Y25 FMC1 HPC DP1GTXE2_CHANNEL_X1Y26 FMC1 HPC DP3GTXE2_CHANNEL_X1Y27 FMC1 HPC DP4 如突出显示的那样,条目DP4显示为银行118和119,因此必须输错。 我无法弄清楚哪一个应该是DP2,哪一个是正确的DP4。 有人知道这个谜的答案吗? |
|
相关推荐
6个回答
|
|
@reisswolfBelow是Schematic中银行的快照,它将为您提供连接
-------------------------------------------------- -------------------------------------------------- ----------------没有一个愚蠢的问题。 随意问,但快速搜索,以确保它还没有得到解答。 保持对话,获得Kudos和Accept Solution。 -------------------------------------------------- -------------------------------------------------- ------------------- 在原帖中查看解决方案 |
|
|
|
你好
请参阅下面的doc,了解引脚的正确映射 http://www.xilinx.com/support/documentation/boards_and_kits/vc707_Schematic_xtp135_rev1_0.pdf X1Y20为DP4,X1Y26为DP2,X1Y27为DP3 问候,萨蒂什----------------------------------------------- --- --------------------------------------------请注意 - 如果提供的信息有用,请将答案标记为“接受为解决方案”。给予您认为有用的帖子。感谢.-- ---------------------------- --------------------- ---------------------- |
|
|
|
@reisswolfBelow是Schematic中银行的快照,它将为您提供连接
-------------------------------------------------- -------------------------------------------------- ----------------没有一个愚蠢的问题。 随意问,但快速搜索,以确保它还没有得到解答。 保持对话,获得Kudos和Accept Solution。 -------------------------------------------------- -------------------------------------------------- ------------------- |
|
|
|
|
|
|
|
@reisswolf您还可以通过点击UG中的发送反馈链接发送有关UG中拼写错误的反馈。
-Pratham ------------------------------------------------ ----------------------------------------------请注意 - 请 如果提供的信息有用,请将答案标记为“接受为解决方案”。给予您认为有用并回复导向的帖子。感谢K- -------------------------------------------------- ----------------------- |
|
|
|
@reisswolfCR已经提起来解决这个问题。
感谢您将此曝光 -------------------------------------------------- -------------------------------------------------- ----------------没有一个愚蠢的问题。 随意问,但快速搜索,以确保它还没有得到解答。 保持对话,获得Kudos和Accept Solution。 -------------------------------------------------- -------------------------------------------------- ------------------- |
|
|
|
只有小组成员才能发言,加入小组>>
2415 浏览 7 评论
2821 浏览 4 评论
Spartan 3-AN时钟和VHDL让ISE合成时出现错误该怎么办?
2292 浏览 9 评论
3372 浏览 0 评论
如何在RTL或xilinx spartan fpga的约束文件中插入1.56ns延迟缓冲区?
2458 浏览 15 评论
有输入,但是LVDS_25的FPGA内部接收不到数据,为什么?
1078浏览 1评论
请问vc707的电源线是如何连接的,我这边可能出现了缺失元件的情况导致无法供电
579浏览 1评论
求一块XILINX开发板KC705,VC707,KC105和KCU1500
438浏览 1评论
2000浏览 0评论
723浏览 0评论
小黑屋| 手机版| Archiver| 电子发烧友 ( 湘ICP备2023018690号 )
GMT+8, 2024-12-20 03:01 , Processed in 1.703740 second(s), Total 88, Slave 72 queries .
Powered by 电子发烧友网
© 2015 bbs.elecfans.com
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 (电路图) 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证:合字B2-20210191 工商网监 湘ICP备2023018690号