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首先介绍下自己的问题。我使用FPGA通过CYUSB3014芯片的特点芯片Slave FIFO接口发送数据至PC。 PC端收到的每帧数据之间的间隔时间太长(即每个FIFO的数据),于是我测量了下flagb的 信号见附件。可以看出,flagb信号的低电平持续时间为270ms,这个时间太长了,远远满 我不在乎。 一、 1。何种原因造成flagb低电平持续这么久?(即FIFO满标志持续时间) 2。是什么意思? 三。是什么意思? 临时的 2.PNG 102.3 K |
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1个回答
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你好,
如果标志B被卡在低电平,则意味着数据没有被主机PC读取。这种情况经常出现的一个常见原因可能是FX3已经进入低功耗模式。 PC可能会迫使FX3进入低功耗模式,因为FX3的DMA中的数据将不被读取。 请调用CYU3PUBLPMDISABLE()API,在CyU3pCeltTe态API之后检查吗? 当做, - Madhu Sudhan |
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请问可以直接使用来自FX2LP固件的端点向主机FIFO写入数据吗?
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