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电子发烧友论坛|
一，如果入门套件参考设计使用ADC。
请参阅：http：//www.xilinx.com/products/boards/s3estarter/reference_designs.htm这是一个基于PicoBlaze的设计。即使您决定创建自己的设计（例如，基于状态机），您应该 无论如何看看Picoblaze设计，你也应该继续实施它作为一个excersize（它需要大约十分钟。）ADC与其他几个设备共享SPI总线，其他所有设备都必须明确取消选择 防止它们干扰ADC。 Spartan 3E入门套件用户指南给出了取消选择平台闪存的错误选择。 参考设计使用正确的意义进行取消选择。 |
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嗨，
我用VHDL开发了这个包装器......如果它是最后一个版本，我不会这样做，但是有很多东西可以将spartan3e adc / amp连接到fpga 我希望它对你有用...... ADC_AMP.vhd 5 KB |
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嗨.......我试图实现你的ADC代码........但是在定义ucd时它显示无法解析的错误........你可以给我详细信息......
...因为我在Verilog工作，而VHDL并不那么熟悉。 所以请帮帮我........ 问候， krunal |
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2019-9-2 07:35:04
评论
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你好。
我是fpga世界的佼佼者，我有一个疑问。 对不起，如果我错了，请告诉我。在代码ADC_AMP.vhd中，我认为以下代码不对： 当START => AMP_CS index1：= 7; - 8位值 当START2 => MOSI ...当LO_DUMMY => MOSI index1：= index1-1; 在这种情况下，从机（可编程放大器）在两种情况下（在第一个HI状态 - 在START2状态之后 - 在第二个HI状态 - 在第一个LO_DUMMY状态之后）获取比特增益（7），并且它从不 获取位增益（0），因此存在错误。 我说的是真的吗？我正在使用Spartan 3AN入门套件。非常感谢！ |
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嗨，
这是我核心的最新版本。 我放的包里面： 1）可编程放大器的模型 2）ADC的模型 通过RS232发送数据的核心 一个简单的测试平台。 我在Spartan3E Starter KIT上设计它：有些人已成功使用它，但我认为使用Starter Kit 3AN时会有一些变化， 例如，我如何禁用strataflash之间可能存在一些差异...... 如果你给代码返回一些反馈和更正，我很高兴。 adc2.rar 199 KB |
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嗨，
感谢您的代码，但无论我尝试过什么，我都无法工作。 我一直在后面的rar-package上使用adc2.vhd。 我稍微修改了一下，我在实体声明中更改了以下两行 ADC0：out std_logic_vector（13 downto 0）：=（其他=>'0'）; ADC1：输出std_logic_vector（13 downto 0）：=（其他=>'0'）; （在架构声明中，在“开始”之前） 信号ADC0：std_logic_vector（13 downto 0）：=（其他=>'0'）; 信号ADC1：std_logic_vector（13 downto 0）：=（其他=>'0'）; 因为我想在vhdl文件中直接使用至少ADC0作为输入。 我的目标是控制另一台带有J4输出的设备，这些设备在使用按钮时工作正常，但我想根据模拟输入自动控制。 信号ADC0现在似乎只是零。 我的设置与Picoblaze Amp ADC控件一起正常工作，但我想在不使用Picoblaze的情况下完成项目。 我是FPGA设计和VHDL的新手。 你可以帮我吗？ |
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我在Spartan 3E板上运行代码adc2.vhd但是我无法获得正确的输出。
我使用扩展连接器将14个输出放置到LED，几乎所有LED都打开，输出不响应输入电压的变化。 所以，我稍微修改了你的代码。但是我得到的问题是有多少警告像 “D：/Sugan/ise/adc_teest/adc.vhd”第49行：过程灵敏度列表中缺少一个或多个信号。 为了能够合成FPGA / CPLD硬件，XST将假设灵敏度列表中存在所有必需的信号。 请注意，合成的结果可能与初始设计规范不同。 丢失的信号是： “ 和 “Xst：647 - 从不使用输入。如果该端口属于顶级块，或者它属于子块，则该端口将被保留并保持未连接状态，并保留该子块的层次结构。” 从不使用输入。 如果该端口属于顶级块或者属于子块并保留该子块的层次结构，则该端口将被保留并保持未连接状态。 警告：Xst：647 - 从不使用输入。 如果该端口属于顶级块或者属于子块并保留该子块的层次结构，则该端口将被保留并保持未连接状态。 即使我将这些参数放在灵敏度列表中并在有限状态机的代码中使用它们。 |
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rupenman436写道：我在Spartan 3E板上运行代码adc2.vhd但我无法得到正确的输出。
我使用扩展连接器将14个输出放置到LED，几乎所有LED都打开，输出不响应输入电压的变化。 所以，我稍微修改了你的代码。但是我得到的问题是有多少警告像 “D：/Sugan/ise/adc_teest/adc.vhd”第49行：过程灵敏度列表中缺少一个或多个信号。 为了能够合成FPGA / CPLD硬件，XST将假设灵敏度列表中存在所有必需的信号。 请注意，合成的结果可能与初始设计规范不同。 丢失的信号是： “ 和 “Xst：647 - 从不使用输入。如果该端口属于顶级块，或者它属于子块，则该端口将被保留并保持未连接状态，并保留该子块的层次结构。” 从不使用输入。 如果该端口属于顶级块或者属于子块并保留该子块的层次结构，则该端口将被保留并保持未连接状态。 警告：Xst：647 - 从不使用输入。 如果该端口属于顶级块或者属于子块并保留该子块的层次结构，则该端口将被保留并保持未连接状态。 即使我将这些参数放在灵敏度列表中并在有限状态机的代码中使用它们。 因此，您将两个端口放在某个进程的敏感列表中 - 但是它们实际上是否已在此过程中使用？ ----------------------------是的，我这样做是为了谋生。 |
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你好;
这是一个古老的主题; 但也许有人可以帮助我...我需要在spartan3E上使用ADC。 我使用过adc2.rar源代码但是我无法成功实现它。 是否有人成功使用此代码，您能解释它是如何工作的吗？ 谢谢：） |
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我在sparttan 3e看到了很多线程和关于adc转换器的帖子，许多专家给出了很多解决方案，但我已经在板上安装了所有代码，但是没有任何代码可以给出成功的结果，即使我也有代码，
我发现我的欲望来自测试台，但在实时应用程序中它也是不成功的，是否需要任何外部设置才能达到此目的？ 如果这个论坛中的任何人都有任何关于adc的代码，那就是成功的帖子请发布给我 Rourab Paul rourabpaul@gmail.com |
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对于rourabpaul，
如果您： 开始一个新的主题 详细说明哪个板，哪个FPGA，你正在使用哪个ADC。 包括模拟行为的细节（超过“不起作用”） 包括哪些有效的细节。 这些只是建议。 - 鲍勃埃尔金德 签名：新手的自述文件在这里：http：//forums.xilinx.com/t5/New-Users-Forum/README-first-Help-for-new-users/td-p/219369总结：1。 阅读手册或用户指南。 你读过手册了吗？ 你能找到手册吗？2。 搜索论坛（并搜索网页）以寻找类似的主题。 不要在多个论坛上发布相同的问题。 不要在别人的主题上发布新主题或问题，开始新的主题！5。 学生：复制代码与学习设计不同.6“它不起作用”不是一个可以回答的问题。 提供有用的详细信息（请与网页，数据表链接）.7。 您的代码中的评论不需要支付额外费用。 我没有支付论坛帖子的费用。 如果我写一篇好文章，那么我一无所获。 |
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您可以在以下链接中找到XILINX FPGA板的一些参考ADC设计
http://www.xilinx.com/support/documentation/boards_and_kits/ug349.pdf http://www.national.com/analog/xilinx 以下应用说明也有助于满足您的要求 http://www.xilinx.com/support/documentation/application_notes/xapp866.pdf http://www.xilinx.com/support/documentation/application_notes/xapp774.pdf 马赫什 |
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只有小组成员才能发言，加入小组>>
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