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通过一些选项探索，我尝试使用PSoC的内部和基于ti系列的ADS7818转换器。我正在使用西格玛-德尔塔转换器，并得出它的抗噪性适合我的应用。
因此，在UART上传输样本时，我可以以较低的速率、平均更少的速度、更少的内存进行采样。 一个缺点是PSOC5只具有1西格玛-德尔塔转换器，并且需要监测两个分流器。有一个测序Sal转化器，但没有测序sigmaδ。一个应用笔记建议使用模拟多路复用器。 附上的项目说明了我是如何实现的。我正在接收一个异步路径警告。我在想用时钟来控制选择对象不是最好的主意吗？在ACLK的每个边缘之前，多路复用器在通道0和1之间交替。DMATHE存储每一个样本作为一个分流器的读数，另一个偏移，另一个分流。有更好的排序方法吗？尽管警告，这个系统似乎正在工作，但我要支付某种噪音惩罚。 固件，CyWrk.CaseV012Zip 771 K 
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我摆脱了时钟误差以下
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