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我想将HSTL18接收器用于spartan-6 IO，因为驱动器使用1.8V HSTL CLASS I.驱动器来自ASIC芯片。
我查找了文件以找出HSTL的最大速度（例如Mb / s），但没有找到结果。 我在哪里可以获得这些信息？ 在文档ug381中，它为VTT为HSTL提供了50Ω的远端并行端接。 我可以为此输入终端选择片上终端吗？ 它对驾驶员有什么其他需求？ 谢谢。 
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3个回答
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@booksim您计划使用Spartan-6作为接收器，并使用ASIC芯片作为驱动程序，ASIC芯片决定了您的驱动速度。
此外，HSTL是单端标准，它们不是为非常高的速度而设计的。 通常采用单端标准，200MHz限制通常是常态。但是，您可以根据PCB设计将其推高，并注意走线阻抗。 最好的方法是弄清楚你可以在这个界面上实现的最大速度是用ASIC芯片模型运行IBIS模拟 - > PCB跟踪 - > Spartan-6接收器，看看信号运行前的速度有多快 你遇到信号完整性问题。 是的，您可以使用内部端接来节省使用外部电阻的成本。 -------------------------------------------------- -------------------------------------------------- ----------------没有一个愚蠢的问题。 随意问，但快速搜索，以确保它还没有得到解答。 保持对话，获得Kudos和Accept Solution。 -------------------------------------------------- -------------------------------------------------- ------------------- |
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没有针对IO标准的最大速度。
这取决于您的电路板终端和影响SI的特性。 理解最大速度的唯一方法是进行SI仿真并了解眼睛的最大速度是什么，并且对接收的良好信号特性没有太大影响。是的，您可以使用片上终端进行输入端接 。 这是Xilinx FPGA的一个优势，可以通过避免外部终端来帮助您节省电路板空间。 谢谢，AnirudhPS：请将此标记作为答案，以防它有助于解决您的问题。如果帖子引导您找到解决方案，请给予赞誉。 |
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Xilinx FPGA中的IO标准（包括HSTL）按照JDEC标准设计。
所以适用于Spartan-6的所有标准规格也都适用。 HSTL IO标准的最大速度/性能不仅取决于标准，还取决于定制电路板物理特性（迹线长度，宽度，厚度，介电特性等）。 因此，由于最终用户板/ PCB设计依赖性，我们不会在文档中指定最大速度。 这在http://www.xilinx.com/support/answers/12866.htm中指定，概念也适用于所有FPGA器件 客户在此问题上的工作是使用IBIS模型和电路板传输线模型进行信号完整性（SI）仿真。 XILINX为此提供了IBIS模型。 通过按照他的电路板设计使用IBIS仿真，客户甚至可以在设计之前获得速度和其他SI结果。 您可以从以下链接下载Spartan-6 IBIS型号：https：//www.xilinx.com/support/download/index.html/content/xilinx/en/downloadNav/device-models/ibis-models/spartan-series -fpgas.html 以下链接文档和培训材料中的信息有助于理解和进行SI模拟 http://www.xilinx.com/products/technology/signal-integrity.html _______________________________________________如果有助于解决您的查询，请将此帖子标记为“接受为解决方案”。 因此，它将有助于其他论坛用户直接参考答案。如果您认为该信息有用且面向答复，请给予此帖子称赞。 |
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