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当我试图使用配置为定时器的TCPWM输出时,我遇到了问题。测量结果表明,在OV输出的脉冲仅为-45纳秒宽,这太小,不能用它作为PWM(UDB版本)的触发。看来,模块内部使用hfclk生成输出。
有没有窍门延长脉宽不使用更多的内部资源? 附加项目 鲍勃 CyrWK.CaseV02.Zip 25.1 K 以上来自于百度翻译 以下为原文 I have got problems when I tried to use the outputs of a TCPWM configured as timer. Measurements revieled that the pulse at the ov-output is just ~45ns wide which is far too small to use it as a trigger for a PWM (UDB-version). It seems that the module internally uses the HFCLK to generate its outputs. Is there a trick to lengthen the pulse width without using more internal resources? Project attached Bob |
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1个回答
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同步只是一个尝试,没有任何东西被触发。附逻辑分析仪图片。
鲍勃 MPX.JPG 155.8 K 以上来自于百度翻译 以下为原文 Syncing was just a try, nothing gets triggered. Logic analyzer picture attached. Bob
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