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always @(posedge sys_clk or negedge sys_rst_n) begin
if (!sys_rst_n) begin key_reg <= 4'b1111; delay_cnt <= 32'd0; end else begin key_reg[0]<= key[0]; if(key_reg [0]!= key[0]) //一旦检测到按键状态发生变化(有按键被按下或释放) delay_cnt <= 32'd1000000; //给延时计数器重新装载初始值(计数时间为20ms) else if(key_reg[0] == key[0]) begin //在按键状态稳定时,计数器递减,开始20ms倒计时 if(delay_cnt > 32'd0) delay_cnt <= delay_cnt - 1'b1; else delay_cnt <= delay_cnt; end end else begin key_reg[1]<= key[1]; if(key_reg [1]!= key[1]) //一旦检测到按键状态发生变化(有按键被按下或释放) delay_cnt <= 32'd1000000; //给延时计数器重新装载初始值(计数时间为20ms) else if(key_reg[1] == key[1]) begin //在按键状态稳定时,计数器递减,开始20ms倒计时 if(delay_cnt > 32'd0) delay_cnt <= delay_cnt - 1'b1; else delay_cnt <= delay_cnt; end end else begin key_reg[2]<= key[2]; if(key_reg [2]!= key[2]) //一旦检测到按键状态发生变化(有按键被按下或释放) delay_cnt <= 32'd1000000; //给延时计数器重新装载初始值(计数时间为20ms) else if(key_reg[2] == key[2]) begin //在按键状态稳定时,计数器递减,开始20ms倒计时 if(delay_cnt > 32'd0) delay_cnt <= delay_cnt - 1'b1; else delay_cnt <= delay_cnt; end end else begin key_reg[3]<= key[3]; if(key_reg [3]!= key[3]) //一旦检测到按键状态发生变化(有按键被按下或释放) delay_cnt <= 32'd1000000; //给延时计数器重新装载初始值(计数时间为20ms) else if(key_reg[3] == key[3]) begin //在按键状态稳定时,计数器递减,开始20ms倒计时 if(delay_cnt > 32'd0) delay_cnt <= delay_cnt - 1'b1; else delay_cnt <= delay_cnt; end end end |
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6个回答
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编译器说我 Error (10170): Verilog HDL syntax error at LPL.v(60) near text "else"; expecting "end"
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请问这样写可以吗
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例程中提供的是对一个按键进行消抖,最简单的做法是将按键消抖模块例化四次,例化的四个模块输入端口就是key[0]~key[3];因为是同一个模块例化四次,所以四个例化名要不一样,比如
key_debounce u0_key_debounce( .sys_clk (sys_clk), .sys_rst_n (sys_rst_n), .key (key[0]), .key_flag (key_flag[0]), .key_value (key_value[0]) ); ...... key_debounce u3_key_debounce( .sys_clk (sys_clk), .sys_rst_n (sys_rst_n), .key (key[3]), .key_flag (key_flag[3]), .key_value (key_value[3]) ); |
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好的 谢谢我改一下
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谢谢大佬,已经成功
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只有小组成员才能发言,加入小组>>
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基于采用FPGA控制MV-D1024E系列相机的图像采集系统设计
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