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出于好奇，还有一个问题。
PSOC引脚结构中二极管的额定值是多少？当然，它们是ESD的好兆头。对他们的评级有什么看法？ 以上来自于百度翻译 以下为原文 Out of curiosity one more question. What is the rating of diodes in the Pin structure of PSoC. For sure they are meabt for ESD. Any idea on what are their ratings. 
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3个回答
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VIL，VIH水平限制在5V偏离轨道，140毫安极限。
调用闭锁。因此，这些规格将被有效地表征。 过程价值由一定的保证金保障。 问候，Dana。 以上来自于百度翻译 以下为原文 The Vil, Vih levels limited to .5V off the rails, and 140 mA limit to invoke latchup. So these specs effectively would be the characterized process values safeguarded by some margin. Regards, Dana. |
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因此，如果我有3.3±0.7的电压（VDDIO是3.3V），那么信号永远不会进入我的PIN，因为二极管为我的信号显示了一个非常低的电阻路径。我说的对吗？？？？
以上来自于百度翻译 以下为原文 So, if I have voltage of 3.3 + 0.7 (Vddio is of 3.3V) then the signal never enters my pin as the diode shows a very low resistance path for my signal. Am I correct??? |
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引脚钳位到VDD+Vth二极管，直到您馈送过多的电流进入
它要么触发寄生SCR机制，要么吹出Vdd bond 电线内部或硅熔化。 如果你没有超过当前额定值，那么信号看起来像“1”一样。 通常情况下。对于数字情况。 对于模拟情况，赛普拉斯没有任何规定的规格。 OpAmps输入外部驱动时的相位反转 他们的CM范围。你必须测试一下。 问候，Dana。 以上来自于百度翻译 以下为原文 The pin clamps to Vdd +Vthdiode, until you feed too much current into it to either trigger the parasitic SCR mechanism, blowing out Vdd bond wire internal, or silicon meltdown. If you do not exceed the current rating then signal looks like a "1" as it would normally. For the digital case. For the analog case, Cypress does not have any stated specs on phase reversal on OpAmps when their inputs are driven outside their CM range. You would have to test for that. Regards, Dana. |
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