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设计目标:
输入电压:5V 输出电压:1.8V 输出电流:4A 最大 电路图如下: 问题现象: 首先将S3和S5置高, 测得电感后级输出稳定在0.736V,没有达到1.8V。使用万用表测量时,显示先到过1.8V后马上下降为0.736V 由于VLDOIN是接在1.8V上的,导致VTT和VTTREF都没有输出0.9V。 VREF输出电压为1.823V,VREFIN的电压也为1.823V。后将VREFIN的电压分压到1.5V,后级输出还是0.736V。 1.请问反馈电阻R477设置为10K,R478不焊接是否正确? 2.MOS管Vin接5V是否会影响输出? 3.电感取值是否合理? 对比了参考电路slur270.pdf中page7没有发现很大的区别,请指出设计中可能存在的问题,谢谢 |
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30 个讨论
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stew 发表于 2019-4-10 22:22 @Vental Mao 根据目前情况总结下来,DRVH信号在轻载的是否能够输出正确的占空比波形,由于轻载占空比波形不连续,后续的振铃波形不对后级稳压电路产生明显影响。 当负载增大到一定程度后,DRVH需要输出连续的占空比波形来驱动后级mosfet,此时由于信号尾部的振铃叠加到后一个周期的占空比信号上去了,导致了后面对mosfet的驱动产生了干扰。 请问是否有办法滤掉尾部的振铃信号,续流二极管是否可以起到滤波效果? DRVL的信号质量一直是比较好的,但是当负载变大后也会出现相位不稳的情况,估计是收到了DRVH信号的影响。 DRVH信号上的振铃如何去掉? 下图为轻负载下,DRVH上的尾部振铃。 |
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Qwang_public 发表于 2019-4-10 23:11 你好,由于我在国外,有时差,很抱歉不能给你及时回复。 关于轻载条件下尾部的振铃这是正常情况,因为在DCM模式下,下管是不导通的,所以当电感电流的di/dt发生跳变时,就会有ring现象产生。 你可以将重载条件下的输入电压波形截图一下么(务必)?谢谢 要减轻重载条件下的ring可以在下管加snubber吸收电路,电阻电容具体取值见附件 |
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stew 发表于 2019-4-10 23:24 提供输入端5V的电压测量波形如下: 目前没有发现5V的输入端有问题或者压降,请参考 目前在轻负载情况小DRVH是非连续的占空比信号,随着负载的变大DRHV将会逐步缩小占空比信号之间的时间间隔,最终成为连续的占空比信号, 是这样么? 如果占空比信号已经联系产生,但是后级没有稳压到1.8V,那么DRVH和DRVL是会保持当前占空比还是会增大占空比? 目前提供了输入端的信号是否可以判断出问题原因了? |
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Qwang_public 发表于 2019-4-10 23:49 你好, 可以提供一下你的PCB layout么。 你的驱动波形发生震荡有可能是layout没有合理布局导致, 1, 输入电容要靠近芯片, 2,SW节点的面积要尽可能小 3, 最好是4层板, 一三层用来走信号线,二四用来屏蔽干扰 4, FB走线应远离高频噪声源,如SW 5, 输出电容应选取陷波频率在震荡频率附近的瓷片电容 6, 电流环路的走线尽可能短,以减小寄生电感 |
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