完善资料让更多小伙伴认识你,还能领取20积分哦, 立即完善>
扫一扫,分享给好友
UARTlite和UART(16550风格)有什么区别?......
以上来自于谷歌翻译 以下为原文 what is the difference between UARTlite and UART(16550 style)?... |
|
相关推荐
4个回答
|
|
我也想知道区别。
PLz帮助我们。 顺便说一句parijatbajpai你完全了解uartlite。 我的意思是你能够通过uartlite从pc到FPGA接收数据。 如果你知道PLZ帮我这个 abhinavpundir@ymail.com 以上来自于谷歌翻译 以下为原文 Ya I also want to know the difference. PLz help us . By the way parijatbajpai do you know uartlite completely.I mean are u able to receive data from pc to FPGA via uartlite. If u knw plz help me with thisabhinavpundir@ymail.com |
|
|
|
您好
在我的头顶,没用过一年或两年的说法。 Uart lite是一个基本的UART,Tx和Rx寄存器,在编译时固定波特率。 UART是一个完整的16550衍生,Tx和Rx寄存器和由软件设置的fifo,波特率,更多关于操作的标志 99.9%的时间,我发现uart lite足够好了。 我似乎记得可能存在许可证差异,但这非常模糊.......... 以上来自于谷歌翻译 以下为原文 HI top of my head, not used said for a year or two. Uart lite, is a basic UART, Tx and Rx registers , with baud rate fixed at compile time. UART is a full 16550 derivative, Tx and Rx registers and fifo, baud rate set by software, lots more flags as to opperation 99.9 % of the time, I find uart lite is more than good enough. I seem to remember there might be a licence differance, but that is very hazzy.......... |
|
|
|
嗨anubhav
在uartlite通信中面临什么问题.. 以上来自于谷歌翻译 以下为原文 hi anubhavwhat problem u r facing in uartlite communication.. |
|
|
|
|
|
|
|
只有小组成员才能发言,加入小组>>
2395 浏览 7 评论
2810 浏览 4 评论
Spartan 3-AN时钟和VHDL让ISE合成时出现错误该怎么办?
2277 浏览 9 评论
3354 浏览 0 评论
如何在RTL或xilinx spartan fpga的约束文件中插入1.56ns延迟缓冲区?
2445 浏览 15 评论
有输入,但是LVDS_25的FPGA内部接收不到数据,为什么?
781浏览 1评论
请问vc707的电源线是如何连接的,我这边可能出现了缺失元件的情况导致无法供电
558浏览 1评论
求一块XILINX开发板KC705,VC707,KC105和KCU1500
405浏览 1评论
1985浏览 0评论
704浏览 0评论
小黑屋| 手机版| Archiver| 电子发烧友 ( 湘ICP备2023018690号 )
GMT+8, 2024-12-4 03:21 , Processed in 1.254948 second(s), Total 53, Slave 46 queries .
Powered by 电子发烧友网
© 2015 bbs.elecfans.com
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 (电路图) 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证:合字B2-20210191 工商网监 湘ICP备2023018690号