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问题1 如下图,Hcounter 在VD_X下降沿的后第七个cli上升沿置0,这里的作用是是什么,为什么在第七个位置置0?Hcounter 在ad9942内部那些信号或者序列会使用到? 有没有VD counter ,有的话也是这样置0吗? 会供给ad9942内部某个信号使用吗?
问题2 vd hd下降沿和cli的上升沿同时出现,复位ad9942内部的计数器,如果vd hd不对其,比如把vd信号提前hd设计 , 这样行不,如果不行,会出现什么问题? 问题3 vd hd信号在什么时间提供,配置ad9942内部寄存器的时候是否需要将vd hd拉高,还是一开始就提供vd hd信号,配置的时候不用管vd hd。 问题4 下图中, 28 dummy pixels是如何产生的,作用是什么? |
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1个回答
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1) 有7个时钟的延时,是由于芯片内部结构决定的。在您的应用中,您只需要注意到这点就可以了。有内部的VD counter,但是VD counter是以整个HD为周期计数的,所以不需要考虑这个问题。
2)请严格按照手册里的说明来提供时序。 3)关于VD/HD提供的时间,请参考数据手册page26 POWER-UP PROCEDURE. 4)这个的CCD相关的知识,您可以参考一些CCD原理的文档。 |
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