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+1还可以理解,不知道为什么加2
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原来如此
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今天又看了下资料,其实不是这样,而是因为SDIO 需要两个时钟,一个是SDIO adapter clock (SDIOCLK = HCLK),另一个是AHB bus clock (HCLK/2) |
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今天又看了下资料,其实不是这样,而是因为SDIO 需要两个时钟,一个是SDIO adapter clock (SDIOCLK = HCLK),另一个是AHB bus clock (HCLK/2) |
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今天又看了下资料,其实不是这样,而是因为SDIO 需要两个时钟,一个是SDIO adapter clock (SDIOCLK = HCLK),另一个是AHB bus clock (HCLK/2) |
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dingyang598 发表于 2018-9-26 13:12 学习了 |
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不错的经验,感谢分享,学习中
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