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1. DM6467和DM8168和FPGA通信有VLYNQ接口，该协议在FPGA里也有对应的IP，采用8b/10b编码，4bit收，4bit发，时钟6467是99MHz，所以理论峰值带宽是上/下行320Mbps，DM6467的内核里有对应的驱动
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rwd2016 发表于 2018-6-21 04:42 非常感谢您的及时回复， 正如您所说的，“理论峰值带宽是上/下行320Mbps”，假设有10MB的数据，这样来回传送就很慢了 我的意思是有没有零拷贝的方式，FPGA能够直接操作内存，省去传送的过程？ |
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邀杯同醉酒 发表于 2018-6-21 04:54 1. 用8168的PCIE和FPGA的Serdes通信，5Gbps/Lane，8168是X2，够用了吧 |
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