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您好，
1. 关于EVM6678的PLL时钟源，请参考EVM附带光盘中的技术手册；板子在做好之后输入时钟肯定是固定的； 2. 可以通过查看当前配置的PLLM及PLLD，根据输入时钟计算当前的工作频率，具体参考PLL user guide及data manual； 3. 计算cycle可以使用读取TSC寄存器求差的方式。 |
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zbb9612 发表于 2018-6-21 05:36 楼主所贴的表我现在也很疑惑，版主的回答也太随意了，一句请参考技术手册就完事了。。。表中列出的多个时钟源好像都是给内核时钟源的，从表中的参数计算正好符合列出的时钟频率。但我自己测试了PLL的设置（PLLM和PLLD），并用示波器测量了TP12管脚，发现内核时钟源是固定的100MHz，又看了硬件设计图，并没有表中体现的多个时钟源。还请版主解惑下。。 |
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个人认为这里指的是硬件设计的时候可能在外部使用不同频率的时钟作时钟源。例如评估板上使用的是100M的时钟，那么PLLD PLLM的配置以及bootmode就按照第4行进行配置。如果做板子的时候用的是其他频率的时钟源，则根据相应的进行配置。
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zbb9612 发表于 2018-6-21 05:36 我想请问一下，芯片运行时能否二次配置PLLM PLLD？ |
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既然已经固定时钟源了，那表的第一项BOOTMODE[12:10]有什么用呢，管脚不按那个值配置，得出来的时钟也还是100MHz。 另：二次配置PLLD PLLM应该可以，调试时GEL配置过PLLM,PLLD，有的示例程序中又重新配置过 |
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1 对啊，我也在疑惑这个问题，求版主解答。。。。urgent.
"既然已经固定时钟源了，那表的第一项BOOTMODE[12:10]有什么用呢"! 2 是不是应该根据自己板子上的时钟来设置BOOTMODE[12:10]，比如时钟如果是80M就用0b010，EVM6678板是100M的就应该用0b011。 那我的时钟如果不在这所列的8个时钟内，就得自己找个相近的值设置这三个管脚。 33如果上面说的正确，可以猜测，DSP的ROM code（bootloader）是根据BOOTMODE[12:10]这三个引脚的值来配置PLLD PLLM的 望大家帮忙 |
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专家的回答具有权威性，各位不要说三说四的，让你查技术手册，你就赶快查，这不是没让你查《大英百科全书》呢。。
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上电时RBL会读取管脚得知当前的输入时钟，从而进行PLL配置，如果没有PLL BOOT PIN，RBL就不能获取当前的输入时钟源。
上电后RBL会初始配置PLL，之后应用程序可以对PLL进行重配。 |
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