完善资料让更多小伙伴认识你,还能领取20积分哦, 立即完善>
always @(posedge clk or negedge rst_n)
begin : clk_div_process if (rst_n == 0) begin count <= 2'b00; clk_div12 <= 0; end else begin if (sync_clk == 1) //同步时钟 begin count <= 2'b00; clk_div12 <= 0; end else if (cycle == `c3) begin count[0] <= ~(count[0] | count[1]); // ????? count[1] <= count[0]; //?????? clk_div12 <= count[1]; //????????? end else clk_div12 <= 0; end end //clk_div_process 一直看不懂有问号的三行语句是什么意思,大神能不能指导一下 |
|
相关推荐
2个回答
|
|
三个触发器串联,第一个触发器的输入是count0和count1过或非门,输出count0打一拍为count1,再打一拍为clk_div 12。
|
|
|
|
仿真一下不就看出来了!
|
|
|
|
你正在撰写答案
如果你是对答案或其他答案精选点评或询问,请使用“评论”功能。
求FPGA 驱动控制ltc2271 或者 ltc2180 或者 ltc2190或者 ltc2202 的代码
1337 浏览 0 评论
418 浏览 0 评论
求助:遇见诡异问题,FPGA模块A输出端口连接模块B输入后,模块A不能正常工作的
1488 浏览 1 评论
475 浏览 0 评论
1445 浏览 1 评论
4307 浏览 95 评论
小黑屋| 手机版| Archiver| 电子发烧友 ( 湘ICP备2023018690号 )
GMT+8, 2024-8-17 22:17 , Processed in 0.641981 second(s), Total 77, Slave 59 queries .
Powered by 电子发烧友网
© 2015 bbs.elecfans.com
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 (电路图) 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证:合字B2-20210191