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fpga外部时钟为差分时钟，该怎么用？

徐砥中 ( 楼主 ) 2017-5-19 10:48:21  只看该作者 倒序浏览
手头上又一块Xilinx的ZC702的评估板，外接给PL的外部时钟有一个固定为200Mhz的 LVDS时钟和可编程的LVDS时钟，那么给到FPGA内部这些时钟该怎么用呢？
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