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本帖最后由 黎释 于 2017-5-17 16:57 编辑 我在FPGA中调用AURORA_8b10b核时,发现在接受端RX_SRC_RDY_N一直为低电平,也就是说一直在接受数据, 可是我在发送端明明有拉高TX_SRC_RDY_N来暂停数据发送(发送空闲序列), 不明白这是为什么?我需要通过RX_SRC_RDY_N信号来作为下级的控制信号, 关键这个RX_SRC_RDY_N还是内部产生的, |
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2个回答
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信号在什么情况下应该拉高?没看到D2时段拉高吗?
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