完善资料让更多小伙伴认识你,还能领取20积分哦, 立即完善>
电子发烧友论坛|
首先,内部时钟HIRC的频率为22MHz,如果您将PLLCON_SETTING设置为CLK_PLLCON_50MHz_HIRC,则会将CLK_PLLCON_50MHz_HIRC设置为50MHz。这意味着您希望通过PLL将22MHz提高到50MHz。 然后,由于您屏蔽了外部时钟,并切换HCLK到PLL,此时时钟仍然是22MHz。这可能是因为您还没有启用PLL或者PLL尚未稳定。 最后,如果您取消屏蔽外部时钟使能并等待外部时钟稳定,HCLK时钟应该能达到HIRC PLL设定的频率,并且可以被切换为50MHz。但是,您提到的“奇怪问题”可能是由于PLL没有正确配置或者在配置PLL时出现了错误。 因此,我建议您仔细检查您的PLL配置并确保它已正确配置。此外,您可能还需要检查PLL稳定器电路并确保其工作正常。最后,确保您的代码没有其他错误,这可能会影响HCLK时钟频率的正确设置。 |
|
|
|
|
只有小组成员才能发言,加入小组>>
1058 浏览 1 评论
1881 浏览 0 评论
1859 浏览 1 评论
3283 浏览 5 评论
3610 浏览 9 评论
1063浏览 1评论
1886浏览 1评论
如何知道嵌入式电子控制单元 (ECU) 中的RAM使用情况?
1390浏览 1评论
1884浏览 0评论
1204浏览 0评论
/9
小黑屋| 手机版| Archiver| 电子发烧友 ( 湘ICP备2023018690号 )
GMT+8, 2025-12-11 07:57 , Processed in 0.443485 second(s), Total 45, Slave 35 queries .
Powered by 电子发烧友网
© 2015 bbs.elecfans.com
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 (电路图) 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证:合字B2-20210191

淘帖
409