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[问答] 是否有任何IP和现有的示例设计可以转换为包装
28 Verilog
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我希望将一些数据从Master转移到slave,反之亦然。那么是否有任何IP和现有的示例设计可以转换为包装,如veriloG代码。之后我可以根据我们的应用程序进行定制..?
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2020-5-22 15:13:13   评论 分享淘帖 邀请回答
1个回答
raviraj @ 56yes,你可以使用xilinx axi qspi IP块来做到这一点(不要担心qspi中的q,它会做你需要的)
- 如果提供的信息有用,请将答案标记为“接受为解决方案”。给予您认为有用且回复的帖子。
2020-5-22 15:32:42 评论

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