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请问如何将Zynq zc702连接到示波器？	胡卫伟 2 小时前	16	屠鸡勇士李运好2 小时前
请问如何将u-boot和Kernal加载到QSPI中？	李万寿 2 小时前	17	林信海892 小时前
在哪里可以找到有关如何连接zynq和以太网千兆位控制器（ksz9021）的文档？	俞舟群 2 小时前	37	jia1993win2 小时前
有没有办法我们可以在包含Fedora 16以外的操作系统上运行TRD？	王桂荣 2 小时前	28	yzmalysys2 小时前
Artix 7系列中使用FrameECC和GCAPTURE命令怎么实现？	李沅璐 2 小时前	27	uuysfwer2 小时前
TXOUTCLK未运行的原因？	何兰兰 2 小时前	36	60user482 小时前
请问如何将zynq zc702 FPGA连接到示波器？	胡卫伟 2 小时前	47	屠鸡勇士李运好2 小时前
UCF文件出现错误的原因？	胡卫伟 2 小时前	58	屠鸡勇士李运好2 小时前
请问virtex 7 690t引脚AB37和AB36通过vivado封装引脚窗口上拉？	王鹏飞 2 小时前	57	想搞硬件的实施人员2 小时前
请问XGpiops.h和XGpio.h之间的区别？	刘阳 3 小时前	712	chm93 小时前
是否可以将一个源同步时钟与多个数据线相关联？	韩刚龙 3 小时前	712	皮皮鲁鲁鲁皮3 小时前
在任何情况下，LUT都可以安全地描述为无故障吗？	杨雪 3 小时前	710	ldd1211_3 小时前
GTX RX如何对齐？	许伟星 3 小时前	710	asp603993 小时前
V-by-One协议，如何设置Equailizer？	刘政玮 3 小时前	311	cnibooji3 小时前
如何从artix 7板的35号银行提供的io中获取差分输出？	梁云 3 小时前	1114	ldp16533 小时前
Artix 7 xc7a35tcsg325-2 LVDS OBUFDS输出有什么建议？	李耀鑫 3 小时前	25	yanxl00283 小时前
如何在virtex 7使用PRC的实验3？	段晓雯 4 小时前	512	wewxvqer4 小时前
xapp524 12位1线模式不会合成的原因是什么？	李长宝 5 小时前	46	qq6749571135 小时前
怎么做才能产生差分信号？	乔丽娜 6 小时前	819	我是卖报的小男孩6 小时前
如何在约束文件中正确分配时钟输入？	韩香茹 6 小时前	1015	young0016 小时前
请问如何实现1到12 DDR数据接收器？	张淑兰昨天 10:44	110	lgjmjx昨天 10:44
不能同时将MGTRXP设置为GND，将MGTTXN设置为Open，可以吗？	康桃花昨天 10:38	18	四川赵赵昨天 10:38
PicoZed 7030接口LVDS 1.8V至2.5V LVDS LTC2323能实现吗？	王桂香昨天 10:33	212	龙胆紫a昨天 10:33
FPGA板需要进行哪些修改才能使其接受32条电缆？	肖蕾昨天 10:32	19	60user184昨天 10:32
在KC705板上通过4x_mode GTX发送和接收数据出现错误的原因是什么？	韩志保昨天 10:30	210	60user120昨天 10:30
请问未使用的CLB是开还是关？	叶恒昨天 10:29	210	cswerwr昨天 10:29
如果在序列模式中使用XADC它如何利用ADC？	陈婧甄昨天 10:21	213	zhan198498昨天 10:21
FPGA IO和GND之间是否存在低阻抗路径？	区沛仪昨天 10:07	416	binro昨天 10:07
如何用xc7z045 FPGA取代xc7z020 FPGA？	刘彦妤昨天 10:04	415	fqweerw昨天 10:04
为什么在本机配置中没有“选择附加时钟”选项？	王丽华昨天 09:56	410	mczxm昨天 09:56