嗨，
警告：sim - BlackBox生成器运行选项'-ifmt'多次发现。
只考虑第一次出现。警告：sim - 覆盖现有的fileC：/。Xilinx / prova_di_block_maker / ipcore_dir / tmp / _cg / provaIP / doc / fifo_generator_v9_2_vinfo.html以及来自xilinx_documentation的文件
以上凸轮也可以忽略不计。
警告：ProjectMgmt - 库“工作”中的重复设计单元'provaIP'
当存在重复设计单元时，项目管理功能会发出此警告消息，该单元基本上是实体名称。
事实上，该工具将采用这些模块中的任何一个，但不是两个模块，这就是为什么一个是“活动”而一个不在警告消息中的原因。
如果有两个确切的文件，随机选择一个没有任何区别。
因此可以安全地忽略该消息。
如果有两个具有相同实体名称的不同文件，则设计将根据采用的不同而不同。
在您的情况下，这两个核心文件provaIP_synth.vhd和provaIP.vhd将具有相同的内容，因此可以忽略警告。
在模拟期间，工具使用addprovaIP.vhd，在合成期间使用provaIP_synth.vhd。
谢谢，
迪皮卡。
谢谢，迪皮卡.----------------------------------------------
---------------------------------------------- Google之前的问题
张贴。
如果某人的帖子回答了您的问题，请将帖子标记为“接受为解决方案”。
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以上凸轮也可以忽略不计。
警告：ProjectMgmt - 库“工作”中的重复设计单元'provaIP'
当存在重复设计单元时，项目管理功能会发出此警告消息，该单元基本上是实体名称。
事实上，该工具将采用这些模块中的任何一个，但不是两个模块，这就是为什么一个是“活动”而一个不在警告消息中的原因。
如果有两个确切的文件，随机选择一个没有任何区别。
因此可以安全地忽略该消息。
如果有两个具有相同实体名称的不同文件，则设计将根据采用的不同而不同。
在您的情况下，这两个核心文件provaIP_synth.vhd和provaIP.vhd将具有相同的内容，因此可以忽略警告。
在模拟期间，工具使用addprovaIP.vhd，在合成期间使用provaIP_synth.vhd。
谢谢，
迪皮卡。
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