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//分频单元
module clock_divder( input sys_rstn, input clk_50M , output reg clk_50Hz ); reg [31:0] cnt; always @(posedge clk_50M or negedge sys_rstn) if (!sys_rstn) cnt <= 32'd0; else if (cnt >= 32'd5)//(cnt >= 32'd499999) cnt <= 32'd0; else cnt <= cnt + 1'b1; always @(posedge clk_50M or negedge sys_rstn) if (!sys_rstn) clk_50Hz <= 1'b0; else if (cnt >= 32'd5)//(cnt >= 32'd499999) clk_50Hz <= ~clk_50Hz; endmodule 
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2个回答
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请问你说的是什么意思
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2016-5-10 21:48:58
评论
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分频50HZ还是太快了，人眼肯定分辨不出来，频率再低点试试。比如10HZ,5HZ
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