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[经验]

fpga一个很好的时序设计教程

2013-9-5 16:41:14

1987

0

本帖最后由 taiyangshenniao 于 2013-9-5 16:42 编辑

各钟加法器，乘法器，除法器，的verilog 的实现，（位运算）

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4 条评论

只看该作者

fantasy1989 2013-9-5 21:57:59

在哪里呢？？？

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石头 2013-9-5 22:15:37

肿么没有看见
在哪里呢？

赞回复

lihanmiaomiao 2013-9-6 08:32:26

谢谢分享，很好的资料！

赞回复

xd192 2013-9-14 21:53:39

资料在哪呢？？

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