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FPGA输出两路具有相位差的高频方波信号,怎样实现?用延时可以吗?怎么实现呢?我是这样做的,可是看不到效果呀!!!reg[1:0] state;
reg[30:0] cnt; always @(posedge clk) begin case(state) 0 : begin cnt = 0; state = 1; end 1 : begin cnt = cnt + 1; if( cnt < 2500000 ) state = 1; else state = 2; end 2 : begin fb = count_r; end default : cnt = 0; endcase end 晶振是50M的 |
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4个回答
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完全不知所云的代码
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你的代码写的有问题,每人能看得懂。建议:
1.如果是高频的,可以通过PLL来实现,相移你在PLL设定就是了,简单; 2.如果是低频的,可以通过计数器来实现,几拍一翻转,delay的拍数可以作为相移的刻度。 |
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楼主,感觉你表达不清楚,请表达清楚再问吧
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看不懂了
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