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module FPGA_test(clk,,ctrl_led);
input clk;//全局时钟 output reg ctrl_led; wire dout; IBUFG CLKIN(.I(clk), .O(clk_ibufg)); BUFG BUFG_inst(.I(clk_ibufg), .O(dout)); always@(dout) begin if((!star_fpga)) begin ctrl_led<=1'b1; end end endmodule 请问全局时钟那块用的对吗? 这个程序一直报ERROR:MapLib:93 - Illegal LOC on IPAD symbol "star_fpga" or BUFGP symbol 但是如果改成always(posedge dout) 程序就没有问题,一直想不通为啥 大家能告诉为啥吗? |
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