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GIC-500是一个构建时可配置的中断控制器，最多支持128个内核。GIC-500仅支持实现ARMv8架构的内核，以及具有标准GIC流协议接口的GIC CPU接口，如Cortex®-A57和Cortex-A53。它实现了ARM®通用中断控制器体系结构规范3.0版、GIC体系结构3.0版和4.0版，以支持：
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