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使用 SerDes 协议 F236 时,我们希望使用 SG2 作为 1000BaseKX。根据参考手册的表 19-1,SerDes bank 1 的所有通道都映射到 PLL1。在这种情况下,PCIe4 支持 Gen3,PCIe1、2 和 3 也都映射到 PLL1。
根据 19.4.2 SerDesxPLLnCR0 部分,DLYDIV_SEL 必须设置为 01 以启用 FRATE_SEL/16。输入 PLL1 参考时钟设置为 100MHz。 问题是
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