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我对用于 lx2160a-rdb 板的默认 RCW 中的 DDR PLL 设置以及参考手册中以下框图中显示的内容感到困惑:
我的困惑是,在 RCW 文件中,对于 2600MT/s DDR,为 MEM_PLL_RAT 和 MEM_PLL_CFG 设置了以下设置: MEM_PLL_CFG =3 MEM_PLL_RAT=26 MEM2_PLL_CFG=3 MEM2_PLL_RAT=26 源时钟设置为 100Mhz,因此 DDR1 时钟和 DDR2 时钟必须为 26*100/4 = 650Mhz,我必须有 1300Mhz 才能达到 2600MT/s? 你能澄清一下吗? |
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1个回答
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更新:时钟的观察显示 MEM_PLL_RAT =26 和 MEM_PLL_CFG=3 时时钟为1300Mhz => 2600MT/s。RCW 中的值是好的,但参考手册中肯定有错误,因为MEM_PLL_CFG = 3 它表示 1/4 除数,因此 2600/4 = 650Mhz。
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