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ARM Cortex-M0端口与总线介绍及其配置

2022-8-8 16:30:08 5646 Cortex-M0 ARM处理器门电路

0 1、Cortex-M0、端口与总线介绍与配置在ARM DesignStart网址下载的Cortex-M0 DesignStart Eval文件资源中找到名为“cortexm0ds_logic.v”的文件，这便是处理器核的网表形式的Verilog代码。在实验开始前，我们需要对处理器核的时钟、复位、无用端口以及DAP的iobuf进行配置。由于ARM DesignStart Eval中提供的处理器核代码为不可读的网表结构（即直接基于基本门电路的描述，想要读懂或了解此类电路逻辑几乎不可能），相关说明文档也极少对处理器核端口有详细的描述，因此这里对端口的配置基本上依赖于DesignStart资料包中提供的参考设计，根据参考资料中的代码尽可能的理解各个端口的意义。首先是System input部分端口，此部分端口为处理器核所需要的各种时钟与复位，时钟与复位作为触发器的基本输入，设置错误将会直接导致整个系统的崩溃与失效，因此这部分端口至关重要。接下来是Power management input/output部分端口，此部分与处理器核功耗管理单元有关，控制处理器核出入睡眠状态（由WFI与WFE指令控制处理器核流水线停止，停止读取与处理指令，整个电路进入功耗极低的状态，最后通过中断与事件唤醒，在本手册内容中不涉及）、调试启动（要将输出端口CDBGPWRUPREQ信号经过同步后接在输入端口CDBGPWRUPACK处）与软复位（CPU的SYSRESETREQ输出信号需要经过同步后接入HRESETn，这是因为在处理器核进入调试模式后，调试器能够向处理器核发送特定代码实现软复位，当其内部复位寄存器被置位后，则通过SYSRESETREQ信号发出复位请求）。原作者：硬木课堂语雀 3 Cortex-M0、端口与总线介绍与配置.pdf 662.96 KB , 下载次数: 23
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