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1、ARM中断等待与异常处理优化 中断等待(延时):从检测到某中断请求,到执行了其服务例程的第一条指令时,已流逝的时间。 可能造成中断等待的情况: CPU正在处理另外一个相同或更高优先级的异常 CPU正在执行非对齐传输 调试器访问存储器系统 有些指令需要较多的周期才能完成: 除法指令 双字传送指令LDRD/STRD 多重数据传送指令LDM/STM/PUSH/POP 对于LDRD/STRD:为了保证中断及时响应而取消它们的执行,待返回后重新开始。 对于多重数据传送指令:支持LDM/STM/PUSH/POP指令的中止和继续,xPSR中的ICI位用于记录指令传输过程被打断时,下一个即将传送的寄存器(LDM/STM在汇编时,都把寄存器号升序排序)。在服务例程返回后,xPSR被弹出,CM3再从ICI bits中获取当时LDM/STM执行的进度,从而可以继续传送。 但是,在IF-THEN(IT)指令的执行也需要在xPSR中使用这些位,且与ICI位重合(类似C中的union),即IT条件。所以,如果在IF-THEN中使用了LDM/STM,则不再记录LDM/STM的执行进度。此时只好把LDM/STM取消,待中断返回后继续执行。 中断嵌套 |
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