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library ieee;
use ieee.std_logic_1164.all; entity dengdai is port(clk: in std_logic; reset: in std_logic; d:in std_logic; q:out std_logic); end dengdai; architecture one of dengdai is begin process begin if reset='1'then q<='0'; elsif clk'event and clk='1'then q<=d; end if; wait on clk,reset ; end process; end one; 这个程序报错为Error (10533): VHDL Wait Statement error at dengdai.vhd(17): Wait Statement must contain condition clause with UNTIL keyword |
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2个回答
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wait on clk,reset 这里出错 一般的只有wait UNTIL 语句才能被综合器接受,其余的只能在VHDL仿真器中使用 建议删除等待 D触发器在上升沿来时自动循环
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{:soso_e129:}
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