write_cfgmem命令不生成多启动Mcs怎么回事

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nagarjuna.k@mistralsolutions.com您需要应用所有SPI相关约束。
应用所有约束并重新运行比特流。
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elow是使用基于SPI SREC引导加载程序的MCS映像从串行闪存启动“外设测试”应用程序的过程。
从SDK创建SPI SREC引导加载程序应用程序。
在SREC引导加载程序应用程序源中，更改blconfig.h中的地址：#define FLASH_IMAGE_BASEADDR例如，如果Vivado项目中的Flash基址（检查地址编辑器）是0xC2000000并且您想要给出0x00C00000的偏移量，那么
FLASH_IMAGE_BASEADDR将为0x00C00000
更改BSP设置包括xilisf（Xilinx在系统和串行闪存库）
重建应用程序。
现在再创建一个应用程序，例如SDK中的外围测试 - 链接到DDR（在链接器脚本中确保此应用程序从DDR执行）
将生成的外围测试精灵转换为SREC格式（mb-objcopy -O srec）
使用Vivado中的write_cfgmem将外围SREC文件转换为MCS格式（MCS中SREC文件的偏移量应该是blconfig.h中指定的偏移量）对于FLASH_IMAGE_BASEADDR为0xC2C00000的上述情况，创建peripheral_test.mcs文件的命令将是
：write_cfgmem -format mcs -size 128 -checksum FF -interface spix4 -loaddata“up 0x00C00000 /path/to/peripheral_test.srec”-force peripheral_test
使用Vivado将theperipheral_test.mcs文件编程到闪存上（注意：在2015.1 SDK中，您可以从bootgen创建MCS文件，SDK也支持编程SPI闪存 - >仍然是intest阶段）
使用SDK通过程序FPGA从system.bit创建download.bit
选择Bitstream（system.bit）和ELF文件来初始化BRAM（步骤5中构建的srec bootloader精灵）
编程FPGA
配置FPGA后，SREC引导加载程序运行，将映像从闪存复制到DDR，并执行外设测试应用程序。
注意：在步骤8中，您还可以添加download.bit（将在步骤11中创建）以创建单片mcs映像，该映像将配置FPGA以及加载用户应用程序。
write_cfgmem -format mcs -size 128 -checksum FF -interface spix4 -loaddata“up 0x0 /path/to/download.bitup 0x00C00000 /path/to/peripheral_test.srec”-force peripheral_test
另外，不要忘记在SPI SREC Bootloader的BSP设置中为serial_flash_family（基于您具有的串行闪存类型）和serial_flash_interface选择适当的值：
谢谢和RegardsBalkrishan -----------------------------------------------
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要在SPIx4或SPIx2模式下正确生成BIN或MCS，应在位文件中正确设置位流属性“SPI_BUSWIDTH”：
set_property BITSTREAM.Config.SPI_BUSWIDTH 4 [current_design]
一种方法是将Tcl命令添加到.xdc并重新运行实现。
没有重新运行的另一种更方便的方法是打开已实现的设计，并在Tcl控制台中连续输出以下命令： 
1.set_property BITSTREAM.Config.SPI_BUSWIDTH 4 [current_design] 
2.write_bitstream xxx.bit（确保不要单击“生成比特流”按钮） 
3.write_cfgmem -format mcs -interface SPIx4-sizexxx-loadbit“up 0x0xxx.bit”-filexxx.mcs
应该成功生成mcs文件。
谢谢和RegardsBalkrishan -----------------------------------------------
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嗨，
感谢您的回复。
我已经为Golden Bitstream应用了以下约束：
set_property BITSTREAM.CONFIG.CONFIGRATE 26 [current_design] set_property BITSTREAM.CONFIG.SPI_32BIT_ADDR YES [current_design] set_property BITSTREAM.CONFIG.SPI_BUSWIDTH 4 [current_design] set_property BITSTREAM.CONFIG.SPI_FALL_EDGE YES [current_design] set_property BITSTREAM.CONFIG.CONFIGFALLBACK ENABLE [current_design]
set_property BITSTREAM.GENERAL.COMPRESS TRUE [current_design] set_property BITSTREAM.CONFIG.NEXT_CONFIG_ADDR 0x01000000 [current_design]
set_property CONFIG_MODE SPIx4 [current_design] set_property BITSTREAM.CONFIG.NEXT_CONFIG_ADDR 32'h00000000 [current_design]
set_property BITSTREAM.CONFIG.NEXT_CONFIG_REBOOT ENABLE [current_design]
并用于生成更新的比特流
set_property BITSTREAM.CONFIG.CONFIGRATE 26 [current_design] set_property BITSTREAM.CONFIG.SPI_32BIT_ADDR YES [current_design] set_property BITSTREAM.CONFIG.SPI_BUSWIDTH 4 [current_design] set_property BITSTREAM.CONFIG.SPI_FALL_EDGE YES [current_design] set_property BITSTREAM.CONFIG.CONFIGFALLBACK ENABLE [current_design]
set_property BITSTREAM.GENERAL.COMPRESS TRUE [current_design] #set_property BITSTREAM.CONFIG.NEXT_CONFIG_ADDR 0x01000000 [current_design]
set_property CONFIG_MODE SPIx4 [current_design] set_property BITSTREAM.CONFIG.NEXT_CONFIG_ADDR 32'h00000000 [current_design]
set_property BITSTREAM.CONFIG.NEXT_CONFIG_REBOOT DISABLE [current_design]
按照http://www.xilinx.com/support/documentation/application_notes/xapp1247-multiboot-spi.pdf中的建议
等待建议，

nagarjuna.k@mistralsolutions.com你有这些限制吗？
例：
set_property CFGBVS VCCO [current_design] set_property CONFIG_VOLTAGE 2.5 [current_design]
我不知道为什么这个约束？
set_property BITSTREAM.CONFIG.NEXT_CONFIG_ADDR 32'h00000000 [current_design]
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谢谢Pratam，
问题在于Vivado工具。
可以使用新的Vivado版本2015.1生成具有用于远程重新配置的两位文件的多重引导.mcs。
你说的限制现在也加了。
现在工具已经生成了xapp1247中提到的.mcs。
谢谢.....

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你好
我有一个带QSPI闪存的Kintex7主板，多重启动不起作用。
我正在使用vivado 2015.2，我的配置与上面的完全相似。
相同的配置适用于我的Virtex7设计完美。
对于Kintex7，我创建了包含Golden和主图像的mcs文件，并使用vivado编程spi flash。
然后，当我打开卡时，我总是看到后退发生在看门狗定时器错误。
这意味着跳跃已经发生，但加载主图像总是超时！
我检查了生成的mcs文件，我确信它的主要图像。
我单独尝试了主图像，并且它在不到2个seonds中加载。
我为看门狗定时器定义的值是10秒。
经过两天的战斗，我现在完全没有想法。
任何想法都非常感谢！