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电子发烧友论坛|
嗨，
我想在EDK中使用ISE中提供的PCI Express IP核，这意味着我应该将所有ISE IP核的verilog模块导入EDK。 这是可能的，如果可能的话请发送相关文件。 谢谢＆amp; 问候， Madhu.B 
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8个回答
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2020-3-24 08:33:07
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请查看附件。
谢谢和RegardsBalkrishan ----------------------------------------------- ---------------------------------------------请将帖子标记为 一个答案“接受为解决方案”，以防它有助于解决您的查询。如果一个帖子引导到解决方案，请给予赞誉。 coregen_clock_in_edk.pdf 814 KB |
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以下链接可以帮助您https://sites.google.com/a/cs.ship.edu/fpga/xilinx-tricks/include-coregenerator-ip-in-edk
谢谢和RegardsBalkrishan ----------------------------------------------- ---------------------------------------------请将帖子标记为 一个答案“接受为解决方案”，以防它有助于解决您的查询。如果一个帖子引导到解决方案，请给予赞誉。 |
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您可以在下面查看ARshttp：//www.xilinx.com/support/answers/37856.html
谢谢和RegardsBalkrishan ----------------------------------------------- ---------------------------------------------请将帖子标记为 一个答案“接受为解决方案”，以防它有助于解决您的查询。如果一个帖子引导到解决方案，请给予赞誉。 |
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你好
我想在EDK中使用ISE的IP核，你提供的答案记录是反向的。 如果有任何与我的查询相关的AR，请你发送。 如果可能请提供文件。 我的操作系统是windows。 谢谢， 马杜 |
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嗨，
感谢您的回复和您提供的链接。 我的查询是在最后一步，您可以查看所有信号，但在我的项目中我只得到.mhs文件中的信号 开始clk_50参数实例= clk_50_0参数HW_VER = 1.00.aEND 当我尝试编辑.mhs文件时，它显示以下错误 错误：EDK：4085 - IPNAME：clk_50，INSTANCE：clk_50_0 - 在MPD中找不到PARAMETER CLKIN1_IN - F： pallani ISE_EDK system.mhs第123行 能帮我解决一下这个问题吗？ 谢谢 马杜 |
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你好
我已按照以下链接中显示的所有步骤操作 http://forums.xilinx.com/xlnx/attachments/xlnx/NewUser/15250/1/coregen_clock_in_edk.pdf 我的查询是在最后一步，您可以查看所有信号，但在我的项目中我只得到.mhs文件中的信号 开始clk_50PARAMETER INSTANCE = clk_50_0PARAMETER HW_VER = 1.00.aEND 当我尝试编辑.mhs文件时，它显示以下错误 错误：EDK：4085 - IPNAME：clk_50，INSTANCE：clk_50_0 - 在MPD中找不到PARAMETER CLKIN1_IN - F： pallani ISE_EDK system.mhs第123行 能帮我解决这个问题吗？ 请紧急 谢谢 马杜 |
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