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我有一个严格的时序要求的应用程序。我需要在特定的时间将数据输出到B端口。特别地，我想要一个带有时间戳的16位DMA信道和一个带有端口B上位字节值的8位DMA信道。削除寄存器。在同一个匹配事件中，我想把8位数据值DMA到B端口。当匹配发生时，我还需要发送一个时钟边沿（不在B端口中）。MCCP已经支持这个内置的。到目前为止，我设计/编码这个没有问题。但是，实际上我需要使用两个定时器比较寄存器和总共四个DMA通道的这些设置中的两个。我的问题是，我不能同时在两个通道中产生时钟边缘（在彼此的微秒之内）。这个要求是因为端口B上的数据线是在时钟之间共享的，所以我需要某种仲裁。内置的DMA仲裁是不够的，因为DMA将发生比微秒要求更快。我考虑过几种解决方案，其中没有一个看起来非常好……1）不知何故，让比较寄存器的时间表具有不同的阶段，这样就不能同时进行比较。换句话说，比较A只能匹配奇数微秒和B仅在偶数上。我不知道是否可以抑制计数器相位。2)比较第二个通道总是启动另一个计时器来延迟一微秒。到目前为止，我还没有弄清楚如何让计时器/mccp仅仅延迟一个事件。3)要求时间戳在一个通道中具有偶数值，而在另一个通道中具有奇数。这会降低我的分辨率，也会导致设计中的其他问题。欢迎任何想法。
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8个回答
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因此，在DMA内存中有两个16位数组。一个表示通道A的时间戳，另一个表示通道B的时间戳。您希望确保第一个数组的每个元素与第二个数组的对应元素之间的绝对差大于您描述为“太接近”的特定值。所以你试着找到一个方法：这就是你要的吗？
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谢谢你的回复。这样可以避免碰撞，但是会因为时间戳的改变而引起抖动。我正在寻找一种保留时间差异的解决方案。在过去，当我在这里发布问题时，我总是对自己想要的东西讲得不够多，感到内疚。我想这次我真的只需要问两个问题.1)有没有办法控制定时器的时基相位，这样两个定时器就不能同时匹配？2)有没有办法对定时器进行编程，使得在触发器上输出事件有一个固定的延迟，然后直到另一个触发器输入才发生更多的输出？这就像是一条延迟线。手册中对同步和触发模式的描述都让我觉得计时器将继续运行，输出将重复。通常情况下，软件可以重置东西，但我尝试在没有软件的情况下重置，甚至没有中断。我知道我询问了很多，但是我非常接近一个解决方案。
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您好，您正在查看哪个PIC24产品/系列……它们具有不同的DMA实现，因此除非您对任何产品开放，否则查看特定产品非常重要……
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PIC24FJ256GA702I认为我知道如何做到这一切。这是一个复杂的解决方案。它使用快速中断来清除定时器中断标志。中断将发生在两个DMA OPS和时钟边沿之后，所以时序仍然是完美的。它需要四个定时器（！）对不起，打扰大家了。我想我希望别人能为我做设计。-）
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我仍然不知道问题是什么。当然，你可以通过稍后启动它来改变定时器的相位。两个阶段的定时计时器仍然可以同时产生一个OC事件。也取决于你和他们的匹配。
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你可以稍后再调定时器的相位。我对此不确定。这将是棘手的，但是当int关闭时，我应该能够处理它。>两相shidted定时器仍然可以同时产生一个OC事件。它的时基以2个用户（500KHz）计时，而相位是50%的不同，那么输出的比较必须至少分开一个用户，对吗？然后输出比较时钟引脚也将分开。
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如果您在第一个计时器之后启动第二个计时器，如果不影响计数，它将保持不匹配。我过去已经这样做了。如果计时器3在自动重新加载中启动，并且计时器4在2uSec之后启动，那么计时器4将保持uSecbehind计时器4。
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但是你通过DMA来比较你的输出。如果输出与FEED A和B比较的差等于相位之间的差异，那么比较事件将同时发生。
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只有小组成员才能发言，加入小组>>
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