完善资料让更多小伙伴认识你，还能领取20积分哦， 立即完善>
3天内不再提示
电子发烧友论坛|
|
|
相关推荐
2个回答
|
|
|
N，
您可以在IMPACT中进行验证，以将已发送到设备的内容与某些（其他）参考位文件进行比较。 如果它们匹配，那么您知道它是哪个比特流。 Austin Lesea主要工程师Xilinx San Jose |
|
|
|
|
|
C，
位文件的名称与项目中的父hdl文件相同，因此请使用该文件对FPGA进行编程。如果您感到困惑，请添加一个新的配置文件，如上所述为父位文件。 最好的问候Handhandjjit |
|
|
|
|
只有小组成员才能发言，加入小组>>
2415 浏览 7 评论
2821 浏览 4 评论
Spartan 3-AN时钟和VHDL让ISE合成时出现错误该怎么办？
2292 浏览 9 评论
3372 浏览 0 评论
如何在RTL或xilinx spartan fpga的约束文件中插入1.56ns延迟缓冲区？
2458 浏览 15 评论
有输入，但是LVDS_25的FPGA内部接收不到数据，为什么？
1088浏览 1评论
请问vc707的电源线是如何连接的，我这边可能出现了缺失元件的情况导致无法供电
579浏览 1评论
求一块XILINX开发板KC705，VC707，KC105和KCU1500
441浏览 1评论
2000浏览 0评论
723浏览 0评论
/6 
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 （电路图） 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证：合字B2-20210191
工商网监
湘ICP备2023018690号
1804
评论
淘帖
1220
