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输入数据data为8 bit并行数据流，基本结构为数据帧，帧长为10字节，帧同步字为H“FF”。clk为输入同步时钟。
1、搜索出数据流中的帧同步字信号，并给出帧同步标志。 2、系统工作开始后，要连续3次确认帧同步字进入锁定状态后才输出帧同步标志。 3、在锁定状态时，如连续出现3次错误的帧同步字，则帧同步标志输出无效，系统重新进入搜索状态；否则继续输出有效的帧同步标志。 大神给点思路呗 
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4个回答
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是FPGA的问题哈
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2的描述还要再具体些。其他的好像不难啊，两三个状态机，一个查表检索（也可以其他方式）就搞定了啊。感觉不用一个小时。
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可以在具体点吗，刚开始学，谢谢了
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你看一下这个人发的帖子，他的帖子里有很多FPGA视频教程，其中按键消抖讲到了状态机，串口232收发讲到了检索，还有很多其他课程，你需要的东西多多少少都有涉及。
这个那个人的资料，http://www.openedv.com/home.php?mod=space&uid=69693&do=thread&view=me&from=space，在他发的主题那里很容易就可以找到你需要的内容。 |
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