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<p><font face="Verdana"><font face="Verdana">集成逻辑电路、组合逻辑电路<br/></font></font></p>
<p><font face="Verdana"><font face="Verdana"><font face="Verdana">实验目的<br/>1. 掌握与非门、或非门、与或非门及异或门的逻辑功能。<br/>2. 了解三态门的逻辑功能以及禁止状态的判别方法。了解三态门的应用。<br/>3. 掌握组合逻辑电路的设计和实现方法。<br/>4. 了解半加器、全加器的逻辑功能及三变量表决电路的逻辑功能。</font><br/></font></font></p> <p><font face="Verdana"><font face="Verdana"><font face="Verdana">实验原理说明<br/>门电路是组成逻辑电路的最基本单元，与非门是组成各种组合电路的基本的环节，其他各种类型的电路通常是在与非门的基础上派生而得的。<br/>1． 常用门电路的逻辑符号和逻辑函数表达式</font><br/></font></font></p> <p><font face="Verdana"><font face="Verdana"> </p></font></font><br/> 
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