完善资料让更多小伙伴认识你，还能领取20积分哦， 立即完善>
3天内不再提示
电子发烧友论坛|
这个问题太宽泛了，比如有具体的型号吗？当前设计数据速率是多少？
|
|
|
|
|
|
做等长的目的就是为了让FPGA正确的采样AD输出的数据。
所以只要A0-A11相对于数据时钟满足正确采样所要求的建立和保持时间就行。有了建立和保持时间的要求，再加上PCB走线的延迟（一般板材是6inch/ns），就可以计算出A0-A11相对时钟最大能差多少了。 现在的Layout工具做等长很容易，所以能做等长就尽量做上吧。如果没有做等长，也可以在FPGA里做延时来保证正确采样所需要的建立和保持时间要求。 |
|
|
|
|
|
是否需要做等长处理取决于延时是否满足FPGA的输入信号要求，具体的延迟时间可以参考微带线和带状线的计算公式
http://www.analog.com/media/cn/training-seminars/tutorials/MT-094_cn.pdf |
|
|
|
|
只有小组成员才能发言，加入小组>>
给ADUM4223 增加信号驱动15V电压就不正常， 波动很大会被烧是什么情况？
1292 浏览 2 评论
ADP5092 SYS端口为2.09V，但是REG_OUT为0是什么原因？
1893 浏览 1 评论
ad7193差分输入ain1与ain2差是正值时，读到电压与实际值误差小，但为负值值，误差就变的很大
4233 浏览 2 评论
8990 浏览 1 评论
3136 浏览 1 评论
ADC3442采集，分析数据出现有规则毛刺，请问是哪方面的问题啊？
1414浏览 3评论
AD7190状态寄存器一直是0x80，连续转换模式下RDY不拉低
1640浏览 2评论
1608浏览 2评论
给ADUM4223 增加信号驱动15V电压就不正常， 波动很大会被烧是什么情况？
1292浏览 2评论
207浏览 2评论
/6 
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 （电路图） 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证：合字B2-20210191
工商网监
湘ICP备2023018690号
2908
评论
淘帖
160
