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ADCLK946输出为LVPECL，是否可以直接给AD9739作为时钟驱动LVDS，在LVPECL转至LVDS电路设计上有需要注意的么？
目前调试过程中，DAC失锁，怀疑时钟的输入幅度不满足要求，946的输出差分摆幅理论为1.6V，按道理是满足9739的时钟输入要求的。实测的相噪是满足要求的，但是目前尚未实测DAC时钟输入端的差分电平为多少。 
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这个问题我也考虑很久了
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目前我也碰到这个问题，DAc失锁，请问找到原因了吗
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