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IO Planning (PlanAhead) post-synthesis时报错

4544 RTL FPGA
2. 如果双击IO Pin Planning - pre-synthesis时,不会报错,但IO Port里什么引脚都没有,这两个问题该怎么解决呢?
请各位赐教

如下是第一个问题的截图:

如下是第二个问题的截图:




0
2018-12-20 15:09:39   评论 分享淘帖 邀请回答 举报
2个回答
2018-12-20 15:09:40 评论

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2018-12-20 16:23:45 评论

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