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AD9220在用FPGA控制时是不是可以直接用PLL产生的10M时钟就可以？我使用内部参考2.5V，将输入端与地短接时，输出的数据是0B80跟0380（13位位OTR位），输入一固定的电压值时输出的数据也不是固定的值，而且数据差别很大。这是怎么回事？
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11个回答
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[size=10.0000pt]您好，您的问题已经提交给ADI相关专家，将邀请专家尽快回答您的问题。谢谢！
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您好。可以使用FPGA提供时钟，注意电平、周期和占空比的要求。但是FPGA产生的时钟jitter相对会大一些，会影响信噪比。请检查VREF引脚的电平，以及参考和电源位置去耦电容的添加。也请检查输入模拟信号的范围是否满足Analog Input Configuration的要求。
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谢谢您的回复，我在AD9220 datasheet的第二页看到 是否意味着AD9220的DVDD只能是5V？？若DVVD是直接从FPGA电源端引入的3.3V，是否有影？还有我的高四位数据一直不稳定，一般是哪几方面的原因呢？参考端加的0.1μf与10μf的电容，电源端加的是0.1μf电容。输入信号直接接的是0电压，怎么会出现高四位不稳定（一直在变化）的现象。。。 |
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您好。DVDD供电可以从2.7V到5.25V 对直流信号转换，ADC可能在低位会有抖动，通常不会在高位变化。 请检查连接、供电和引脚配置等。AD9220输出码值是二进制补码，也请使用示波器检查输入信号的范围，可以对应数据手册表格I的配置 |
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我又看了遍数据手册发现在第20页，在Digital Output Driver Considerations (DVDD)标题下写着 However, the AD9220AR can only be configured to interface with +5 V logic families。。。 |
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如果时钟VOH用的3.3V的电压有什么影响？
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您好。在DVDD供电5V时，时钟输入的最小电压在3.5V，3.3V是不满足要求的。如果使用高电平3.3V 时钟，需要使更低的DVDD供电 |
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看样子，楼主需要额外添加一个逻辑电平转换的接口芯片。另外我也想知道FPGA的PLL产生的时钟对AD转换的影响具体怎么量化或者评价？ |
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好吧，明白了。。。 |
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请问，大哥，对于使用AD9220这芯片模块，有什么注意事项吗？求分享
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