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在官网上下载的ad9914的评估开发板原理图中，时钟驱动芯片为ADCLK925，关于ADCLK925的输出有点疑问,请大家帮忙讨论解决下？
ADCLK925采用单端交流耦合输入，时钟3.5GHz，功率5dBm左右，当ADCLK925的输出端与ad9914时钟输入端之间的隔直电容去掉时，测得 用示波器测得ADCLK925输出信号的幅度为700mv左右（单端），当隔直电容（0.1uF）焊上时,ADCLK925的输出变成了400mv左右（单端），经过 隔直电容后，信号幅度变成了250mv左右。请问为什么隔直电容对ADCLK925的输出会产生这么大的影响？为什么时钟的幅度会变小？ 
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请您核查负载是否有接100欧的匹配电阻。
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因为频率达到了3.5GHz，可将电容换成30pF试一试。电容一般不会造成这么大的幅度变化影响。 |
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将ad9914芯片去掉后，adclk925的输出就正常了，用示波器测得单端500mv多。按ad9914 的datasheet，其时钟输入阻抗为1.4k，与时钟驱动的输出阻抗比为高阻抗，应该不会造成这么大的幅度衰减，请问这是为什么？ |
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chuidi515 发表于 2018-11-8 07:03 您好！您可以把测试电路、测试点和测试的波形发到china.support@analog.com. |
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只有小组成员才能发言，加入小组>>
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