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@使用AD9858评估板中的DDS和PLL来实现YTO（或者叫YIG）的锁频，但是目前锁不住，我想有可能是环路滤波器的问题，照着网上的资料下载了ADI计算PLL参数的软件，发现里面可以选择的芯片没有AD9858。
问题1：请问怎么计算与AD9858片内PLL结合使用的环路滤波器参数？ 问题2：YTO频率锁不住，还有可能是什么问题？ 谢谢！ 
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3个回答
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1. 要正确设计PLL的环路滤波器，请指定以下参数：1） PFD rate FPFD 2) 输出频率Fout或者反馈分频系数N 3) VCO 灵敏度Kvco，4） 期望的环路带宽BW和相位裕度phi，5） 电荷泵电流。有了这些才能计算出所需要的Cpole, Rzero， Czero。
2） 请问您是如何实现YTO的？ |
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VERTEX2016 发表于 2018-9-28 07:25 你好，谢谢你的耐心回答！假设我现在需要YTO输出5GHZ频率，那我用FPGA通过DA模块控制YTO主线圈，让YTO在5G附近，因为YTO主线圈没有那么精确能在5G那里稳住；接下来让YTO的输出通过16分频后作为AD9858的系统时钟，通过FPGA控制DDS和PLL，使CP去控制YTO副线圈，从而达到稳定在5Ghz处。 顺便问下，就是PLL一般锁不住是不是很大程度上是环路滤波器的问题，用不用考虑其他问题，比如我副线圈是电流控制的，那CP出来的电流经过环路滤波器之后再转成电流，这样转成电流这个过程的电路响应时间需不需要考虑呢？该电路主要有运放和三极管组成！ |
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mmuwyrwe 发表于 2018-9-28 07:32 Danvy, PLL锁不住的原因有很多，我们需要设计一个稳定的相位控制系统，包括响应时间，其实响应时间取决于设计的控制系统的带宽和相位裕度。 Yiming |
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