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大家好,我现在设计一个时钟源,由压控振荡器输出10MHz时钟,需要经过一个时钟合成器输出62MHz(jitter值小于2ps)作为高精度ADC和FPGA的时钟源,可是我在ADI官网上寻找了很久,发现符合要求的封装都比较大(大于5mmx5mm),请问大家有没有类似的设计?可否推荐下用什么型号的芯片啊?小弟谢谢了!
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2个回答
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看一下AD9550 AD9552/53是否满足你的要求
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压控振荡器(VCO)输出的时钟近端(<100kHz)相位噪声通常很差,若把VCO放到锁相环的的本地振荡器的位置而利用其远端的相位噪声尚可接受。你这里提到的10MHz应该是晶体振荡器吧?若是,hpkamen推荐的AD9552/53可是可行方案。
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