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模拟IC设计与使用VHDL语言设计IC的区别

2018-8-29 09:45:43 4950 模拟IC VHDL语言

0 感觉模拟IC设计就应该是设计模拟电路.设计运放等，通过设计电路、在硅片上搭建TTL.CMOS......从而做成IC芯片；而我经常看到说IC设计就是使用VHDL语言设计IC，写好VHDL语言后烧录到FPGA.CPLD.......从而做成芯片。我想问的是这两者有什么区别？ 0
2018-8-29 09:45:43　　评论淘帖0 举报相关推荐 • 功率ic是模拟芯片吗？功率ic和模拟ic的区别是什么？ 5912 • 功率ic和模拟ic的区别在哪 1326 • 模拟IC和功率IC有何区别 1247 • 模拟版图设计和模拟ic设计的区别 9879 • 一文读懂模拟IC与数字IC的区别 3538 • ic是什么意思 IC和芯片的区别 17569 • 什么是ic设计 ic设计和芯片设计区别 8244 • 什么是模拟IC？模拟IC设计要求和应用 4088 • 模拟IC设计条件_模拟IC设计特点 3243 • 模拟IC与数字IC对比 3256 2 个讨论

0 模拟IC设计和数字IC设计的区别。用的软件工具、逻辑不一样，原理一样

2021-3-1 13:40:44 评论举报 1^# melidna_li

0 电路原理。但测重的应用原理不一样

2021-3-1 13:41:01 评论举报 2^# melidna_li

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