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我看资料上有介绍这些内容,但是有几个不是很明白。内核使用的是1.8V的电压,这个电压是否供给内核中的ADC的前端缓冲使用?如果是的话,那么当输入信号的对地电压超过了1.8V时信号是否被截断呢?
输出的两路恒流源是否可以并联加大电流强度?当两路并联时是否可以只开启一路以调节输出电流呢? 是否可以只使用内部晶振而不使用外部晶振? 非常感谢! |
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4个回答
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是1.8V给ADC前的buffer供电,但是不会出现你所担心的情况,输入信号需要满足datasheet中的table2和table3,以及specification中对absolute input voltage range,differential input voltage range 和 common-mode voltage 的要求。
可以两路恒流源并在一起输出,但是请注意恒流源输出的大小不能单独控制,也就是改变恒流源的电流大小,两路会同时变动。 推荐使用芯片内部的高精度,低温漂的16MHz晶振。 |
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你好,
非常感谢你答复。 我现在使用内部ADC,外部基准源3V,系统电源3.3V时遇到一个奇怪的问题。我的输入信号范围是-3 ~3V的差分信号,每个输入端的信号是0.15 - 3.15V的范围。我想使用内置的前端输入缓冲器以将信号稳定地输入到ADC转换器中。根据资料上的介绍在开启输入缓存时输入信号的范围是AGND + 100mV ~AVDD - 100mV。而我的输入信号完全在这个范围内,应该符合要求。 但是实际测试发现,输入信号的任意一端在AVDD-100mV时,另一端的信号不能低于500mV,当低于500mV时输出会比理论值偏小。而当把输入缓冲器关闭时则正常。可以接受一端输入为150mV另一端为3.15V的信号。 这个与资料手册的介绍差别非常大,找不到原因也试了一些方法但是都未能解决。 请高手支招,非常感谢! |
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是的,在手册上已经说明了,当Gain=1的时候,buffer必须关闭。
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