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问大家一个SPI问题，ARM采用am335X作为主机，FPGA作为从机，模式是3模式，即CPOL=1，CPHA=1，我在FPGA检测SCK的上升沿和CS_n为低电平时，进行把MOSI数据放入缓存器中，当然现在传输数据是没问题，最大的问题是，ARM连续发数据时，假如连续发1和2，sck设定5MHZ时钟，FPGA的时钟要达到600MHZ才能检测出来1和2，FPGA时钟慢了，只能收到一个数据2，大家可以帮分析下，是什么原因吗？
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5个回答
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降低频率就好了
最佳答案
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能降低频率，也就不这么纠结了，理论上速度可以很快，我现在SPI时钟才5M，不算快，现在就接收有问题，所以，我想是FPGA那端设置有问题，但是，我仔细看了代码思路，也没有问题，就是存在优化问题，所以，在这里问下，有没有好的思路
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厉害厉害！！旁观的小白
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SPI 既然有SCLK作为时钟信号，本身就是一个同步逻辑，考虑使用SCLK直接作为FPGA的时钟。这样就不用使用过采样的形式来收数据了
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5#楼的回复可参考借鉴，感觉应该可行。
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