一个神奇多功能的FPGA设计模板！！

FPGA

FPGA工程师都知道，Verilog代码绝大部分都是always语句，结构基本上都是一致的，为了减少重复性的工作，让工程师专注于设计实现，明德扬精心制作了常用模板，只要你安装好明德扬提供的GVIM，就能使用这些模板了。

1.时序逻辑的模板

在GVIM输入“Module”并回车，如下图所示

就能得到下面的时序逻辑的模板。

模块的模板包括了输入输出信号列表、信号定义，组合逻辑和时序逻辑等，这是一个模块常用的组件。学员只需要理解各个部分的意义，按要求来填空就可以，完全没有必要去记住。我看很多学员刚开始学习时，花费大量的时间去记住、背熟模块，这是没有意义的。

2.输入“Reg”并回车。

就能得到单比特的reg信号定义

3.输入“Reg2”并回车

就能得到2比特的reg信号定义

4.输入“Reg8”并回车

就能得到8比特的reg信号定义

类似的快捷命令有：

要使用上面快捷命令，需要明德扬的配置文件，欢迎关注明德扬公众号“fpga520”，或群97925396索取。口号：多用模板，减少记忆，专注设计。

冯景浦 · 2017-5-8 15:17:48

很实用，我也是搞FPGA的，所以感觉非常漂亮！！！

chunfen2634 · 2017-5-11 16:11:31

xiexie

xiao1cao · 2017-5-15 19:14:37

请问你有Gvim的配置文件吗？我的代码每次综合之后再用Gvim打开中文注释就变成乱码了

东东 · 2017-6-25 12:03:26

暑假即将来临，想学习FPGA的同学们，可以利用暑假期间好好学习下FPGA，我们现在有款初学者的FPGA开发板利器，现在购买还有配套书籍赠送哦：
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